多核与多执行绪的嵌入式系统解决方案
如果利用多执行绪处理概念，适时的将其它执行绪拉过来填补已经造成的闲置状态，其速度的增长甚至可以达到非常明显的地步，虽不至于倍增，但是由20％到40％都有可能。而要达成这样的目的，在晶体管数目方面只需增加约15％的程度即可，若以一般同样架构的单核心处理器在变更为双核心的效能增长程度约为40％到70％左右的程度，而晶体管数目几乎要倍增的情况，就可看出MIPS的MT技术的效率有多高了。但是MT技术有个严重的缺陷，那就是多执行绪工作处理过程中，过于频繁的上下文切换（context switch）将有可能会造成极大的效能耗损。
图说：MIPS 74K处理器结构示意图。
MIPS公司有大产品线，分别是单执行绪的24K与74K系列，以及多执行绪的34K系列。74K甫于今年六月发表，在65nm制程下，其运作频率已经超越1GHz，采用通用处理器搭配DSP核心的设计，不过总体效能与功耗表现略逊于类似扁平型电感架构的ARM Cortex-A8。多执行绪处理器的主角—34K系列，该处理器核心能设定1或2个虚拟处理组件（VPE）以及最多5个执行绪内容（TC），提供充分的可配置弹性。但是讲白了，其实两个VPE的作法就是将单颗核心模拟为2个核心，使34K核心能同时执行两个独立的操作系统，或是一个双路的对称式多重处理器操作系统。
MIPS32 34Kc核心采用90nm制程，最差操作状态下频率为500MHz。核心尺寸为2.1mm2，而核心部分耗电量为0.56mW/MHz@1.0V。目前该系列核心共包含34Kc、34Kf、34Kc Pro以及34Kf Pro。这些核心具备完全兼容于IEEE 754规格的硬件浮点运算处理器。其中34Kc Pro与34Kf Pro核心具备CorExtend功能，能让SoC研发业者自行扩增指令。
图说：MIPS 34K处理器结构示意图。
根据MIPS自家的估算，与同家族的24K系列产品相较起来，34K在2个VPE以及2个TC的组态设定之下，可以将效能提升到超越24K处理器 60％的程度，芯片面积大略增加14％，而因为多执行绪作业所导致的高速缓存失误比率则是由4.41％增加到5.16％，算是在可接受的范围之内。不过与单核心74K相较起来，34K反而更不适用于网络或多媒体串流的密集计算环境，而VPE和TC单元的增加，同样也会加大芯片的面积。虽说MT技术的局限性，使其不适合用于多媒体编译码应用上，但是在汽车电子方面，已经有厂商成功利用2颗34K处理器组成双核多执行绪处理器，绕行电感器并提供的相当优秀的执行效能，有此成功的前例可循，我们也可以预测，未来MIPS将会有更多结合多陶瓷电感核与多执行绪的解决方案出现，不过这么一来，在成本调配方面的优势大功率电感还能剩下多少，就由方案提供厂商去伤脑筋吧。
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电路
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